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品牌众多:举例以下四大系统备件。
PLC可编程控制系统备件:
Allen-bradley:1756 1771 1785
摩尔: 1FT 1FK
莫迪康:140CPU AS
GE:IC697 IC698
Motorola:MVME162 MVME137 MVME147
Xycom:XVME
DCS控制系统备件:
DCS集散控制系统:
GE:DS200,IS200,IS215,IS420等燃机卡系列
Invensys Foxoboro:FBM01 FBM02 FBM09 FBM10 FBM201 FBM209
Invensys Triconex: 3503E 3664 3721 3625 4351D 3700A
ABB bailey:BRC300 BRC400 BRC410 AC800 IMASI23
Westinghouse Ovation:IC31
伺服控制系统备件:
Kollmorgen: SM71K 6SM27 AKV23F 60WKS 65WKS
摩尔: 6DD1606 6SN1118 6FC5203 6RB2000 6SC6508 6FX2007 6FM2805 6AV6542
Bosh Rexroth: HCS02.1E HMS01.1N HLB01.1C MSK060B MKE118B MSM020B MHD071B
SEW: MDX61B0022 MDS60A0040 MDF60A0015 MDV60A0015 MCH42A0220 MCV40A0075
机器人控制系统备件:
KUKA: KRC1 KRC2 KRC4 KPS600 KCP2
ABB: 3HAB 3HAA 3HAC DSQC345
FANUC: A02B A03B A04B A05B A06B
Yaskawa: CACR JUSP JZNC JANCD HW
直接数字式频率合成器DDS(Direct Digital Synthesizer),实际上是一种分频器:通过编程频率控制字来分频系统时钟(SYSTEM CLOCK)以产生所需要的频率。DDS 有两个突出的特点,一方面,DDS工作在数字域,一旦更新频率控制字,输出的频率就相应改变,其跳频速率高;另一方面,由于频率控制字的宽度宽(48bit 或者更高),频率分辨率高。
DDS工作原理
Error! Reference source not found. 是DDS 的内部结构图,它主要分成3 部分:相位累加器,相位幅度转换,数模转换器(DAC)。
图 1,DDS的结构
相位累加器
正弦波,虽然它的幅度不是线性的,但是它的相位却是线性增加的。
DDS 正是利用了这一特点来产生正弦信号。如图 2,根据DDS 的频率控制字的位数N,把360° 平均分成了2的N次等份。
相位累加器原理
假设系统时钟为Fc,输出频率为Fout。每次转动角度360°/2N, 则可以产生一个频率为Fc/2N 的正弦波的相位递增量。那么只要选择恰当的频率控制字M,使得 Fout / Fc= M / 2N,就可以得到所需要的输出频率Fout,
Fout = Fc*M / 2N,相位幅度转换通过相位累加器,我们已经得到了合成Fout 频率所对应的相位信息,然后相位幅度转换器把0°~360°的相位转换成相应相位的幅度值。比如当DDS 选择为2V p-p 的输出时,45°对应的幅度值为0.707V,这个数值以二进制的形式被送入DAC。这个相位到幅度的转换是通过查表完成的。
DAC 输出代表幅度的二进制数字信号被送入DAC 中,并转换成为模拟信号输出。注意DAC 的位数并不影响输出频率的分辨率。输出频率的分辨率是由频率控制字的位数决定的。直接数字式频率合成技术(DDS)是一种先进的全数字频率合成技术,它具有多种数字式调制能力(如相位调制、频率调制、幅度调制以及I/Q正交调制等),在通信、导航、雷达、电子战等领域获得了广泛的应用。在项目中光栅传感系统高频并行解调算法的FPGA实现我们的光纤通信模块用到DDS。我们通过FPGA 实现了DDS的功能。
1971年,美国学者J.Tierney等人撰写的《A Digital Frequency
Synthesizer》一文提出了以全数字技术,从相位概念出发直接合成所需波形的一种新的频率合成原理。限于当时的技术和器件水平,它的性能指标尚不能与已有的技术相比,故未受到重视。近10年间,随着微电子技术的迅速发展,直接数字频率合成器(Direct Digital Frequency Synthesis简称DDS或DDFS)得到了飞速的发展,它以有别于其它频率合成方法的优越性能和特点成为现代频率合成技术中的佼佼者。具体体现在相对带宽宽、频率转换时间短、频率分辨率高、输出相位连续、可产生宽带正交信号及其他多种调制信号、可编程和全数字化、控制灵活方便等方面,并具有极高的性价比。
DDS基本原理及性能特点
DDS的基本原理是利用采样定理,通过查表法产生波形。DDS的结构有很多种,其基本的电路原理如图所示。
相位累加器由N位加法器与N位累加寄存器级联构成。每来一个时钟脉冲fs,加法器将频率控制字k与累加寄存器输出的累加相位数据相加,把相加后的结果送至累加寄存器的数据输入端。累加寄存器将加法器在上一个时钟脉冲作用后所产生的新相位数据反馈到加法器的输入端,以使加法器在下一个时钟脉冲的作用下继续与频率控制字k相加。这样,相位累加器在时钟作用下,不断对频率控制字进行线性相位累加。由此可以看出,相位累加器在每一个时钟脉冲输入时,把频率控制字累加一次,相位累加器输出的数据就是合成信号的相位,相位累加器的溢出频率就是DDS输出的信号频率。
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